數(shù)字電路設(shè)計(jì)工程師
20000-40000元
應(yīng)屆畢業(yè)生
碩士
應(yīng)屆畢業(yè)生
碩士
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
2025-04-23 07:40:49
1623人關(guān)注
職位描述
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職責(zé)描述：
1. 與產(chǎn)品/架構(gòu)團(tuán)隊(duì)合作，根據(jù)業(yè)務(wù)需求，完成芯片中IP 架構(gòu)和特性的定義；
2. 編寫IP子系統(tǒng)的硬件架構(gòu)和設(shè)計(jì)文檔, RTL電路實(shí)現(xiàn)；
3. 承擔(dān)IP子系統(tǒng)的集成、交付；
4. 協(xié)助驗(yàn)證團(tuán)隊(duì)完成IP子系統(tǒng)的驗(yàn)證；
5. 協(xié)助中后端團(tuán)隊(duì)完成IP子系統(tǒng)的物理實(shí)現(xiàn)；
6. 負(fù)責(zé)芯片回片后系統(tǒng)級(jí)的測(cè)試、調(diào)試。
任職要求：
1. 有扎實(shí)的數(shù)字電路設(shè)計(jì)基礎(chǔ)，熟悉verilog語言；
2. 2年以上數(shù)字電路設(shè)計(jì)工作經(jīng)驗(yàn)，熟悉數(shù)字電路設(shè)計(jì)流程；
3. 有團(tuán)隊(duì)合作精神，吃苦耐勞的品質(zhì)，積極上進(jìn)；
4. 具備SoC集成經(jīng)驗(yàn)，熟悉時(shí)序，低功耗設(shè)計(jì)，理解SDC，UPF者優(yōu)先考慮；
5. 具有PCIe/USB/SATA/UFS/MIPI等高速接口設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮。
注：聯(lián)系我時(shí)，請(qǐng)說是在白云人才網(wǎng)上看到的。
工作地點(diǎn)
地址：成都雙流區(qū)成都-雙流區(qū)天府?dāng)?shù)智谷4號(hào)樓6層
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職位發(fā)布者
HR
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